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内容大纲
本书共10章,基于公开文献全方位地介绍了低温等离子体蚀刻技术在半导体产业中的应用及潜在发展方向。以低温等离子体蚀刻技术发展史开篇,对传统及已报道的先进等离子体蚀刻技术的基本原理做相应介绍,随后是占据了本书近半篇幅的逻辑和存储器产品中等离子体蚀刻工艺的深度解读。此外,还详述了逻辑产品可靠性及良率与蚀刻工艺的内在联系,聚焦了特殊气体及特殊材料在等离子体蚀刻方面的潜在应用。最后是先进过程控制技术在等离子体蚀刻应用方面的重要性及展望,以及虚拟制造在集成电路发展中的应用。
本书可以作为从事等离子体蚀刻工艺研究和应用的研究生、科研人员和工程技术人员的参考书籍。 -
作者介绍
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目录
第1章 低温等离子体蚀刻技术发展史
1.1 绚丽多彩的等离子体世界
1.2 低温等离子体的应用领域
1.3 低温等离子体蚀刻技术混沌之初
1.4 低温等离子体蚀刻技术世纪初的三国演义
1.5 三维逻辑和存储器时代低温等离子体蚀刻技术的变迁
1.6 华人在低温等离子体蚀刻机台发展中的卓越贡献
1.7 未来低温等离子体蚀刻技术展望
参考文献
第2章 低温等离子体蚀刻简介
2.1 等离子体的基本概念
2.2 低温等离子体蚀刻基本概念
2.3 等离子体蚀刻机台简介
2.3.1 电容耦合等离子体机台
2.3.2 电感耦合等离子体机台
2.3.3 电子回旋共振等离子体机台
2.3.4 远距等离子体蚀刻机台
2.3.5 等离子体边缘蚀刻机台
2.4 等离子体先进蚀刻技术简介
2.4.1 等离子体脉冲蚀刻技术
2.4.2 原子层蚀刻技术
2.4.3 中性粒子束蚀刻技术
2.4.4 带状束方向性蚀刻技术
2.4.5 气体团簇离子束蚀刻技术
参考文献
第3章 等离子体蚀刻在逻辑集成电路制造中的应用
3.1 逻辑集成电路的发展
3.2 浅沟槽隔离蚀刻
3.2.1 浅沟槽隔离的背景和概况
3.2.2 浅沟槽隔离蚀刻的发展
3.2.3 膜层结构对浅沟槽隔离蚀刻的影响
3.2.4 浅沟槽隔离蚀刻参数影响
3.2.5 浅沟槽隔离蚀刻的重要物理参数及对器件性能的影响
3.2.6 鳍式场效应晶体管中鳍(Fin)的自对准双图形的蚀刻
3.2.7 鳍式场效应晶体管中的物理性能对器件的影响
3.2.8 浅沟槽隔离蚀刻中的负载调节
3.3 多晶硅栅极的蚀刻
3.3.1 逻辑集成电路中的栅及其材料的演变
3.3.2 多晶硅栅极蚀刻
3.3.3 台阶高度对多晶硅栅极蚀刻的影响
3.3.4 多晶硅栅极的线宽粗糙度
3.3.5 多晶硅栅极的双图形蚀刻
3.3.6 鳍式场效应晶体管中的多晶硅栅极蚀刻
3.4 等离子体蚀刻在锗硅外延生长中的应用
3.4.1 西格玛形锗硅沟槽成型控制
3.4.2 蚀刻后硅锗沟槽界面对最终西格玛形沟槽形状及硅锗外延生长的影响
3.5 伪栅去除
3.5.1 高介电常数金属栅极工艺
3.5.2 先栅极工艺和后栅极工艺
3.5.3 伪栅去除工艺
3.6 偏置侧墙和主侧墙的蚀刻
3.6.1 偏置侧墙的发展
3.6.2 侧墙蚀刻
3.6.3 先进侧墙蚀刻技术
3.6.4 侧墙蚀刻对器件的影响
3.7 应力临近技术
3.7.1 应力临近技术在半导体技术中的应用
3.7.2 应力临近技术蚀刻
3.8 接触孔的等离子体蚀刻
3.8.1 接触孔蚀刻工艺的发展历程
3.8.2 接触孔掩膜层蚀刻步骤中蚀刻气体对接触孔尺寸及圆整度的影响
3.8.3 接触孔主蚀刻步骤中源功率和偏置功率对接触孔侧壁形状的影响
3.8.4 接触孔主蚀刻步骤中氧气使用量的影响及优化
3.8.5 接触孔蚀刻停止层蚀刻步骤的优化
3.8.6 晶圆温度对接触孔蚀刻的影响
3.9 后段互连工艺流程及等离子体蚀刻的应用
3.9.1 后段互连工艺的发展历程
3.9.2 集成电路制造后段互连工艺流程
3.10 第一金属连接层的蚀刻
3.10.1 第一金属连接层蚀刻工艺的发展历程
3.10.2 工艺整合对第一金属连接层蚀刻工艺的要求
3.10.3 第一金属连接层蚀刻工艺参数对关键尺寸、轮廓图形及电性能的影响
3.11 通孔的蚀刻
3.11.1 工艺整合对通孔蚀刻工艺的要求
3.11.2 通孔蚀刻工艺参数对关键尺寸、轮廓图形及电性能的影响
3.12 金属硬掩膜层的蚀刻
3.12.1 金属硬掩膜层蚀刻参数对负载效应的影响
3.12.2 金属硬掩膜层材料应力对负载效应的影响
3.12.3 金属硬掩膜层蚀刻侧壁轮廓对负载效应的影响
3.13 介电材料沟槽的蚀刻
3.13.1 工艺整合对介电材料沟槽蚀刻工艺的要求
3.13.2 先通孔工艺流程沟槽蚀刻工艺参数对关键尺寸、轮廓图形及电性能的影响
3.13.3 金属硬掩膜先沟槽工艺流程沟槽蚀刻工艺对关键尺寸、轮廓图形及电性能的影响
3.14 钝化层介电材料的蚀刻
3.15 铝垫的金属蚀刻
参考文献
第4章 等离子体蚀刻在存储器集成电路制造中的应用
4.1 闪存的基本介绍
4.1.1 基本概念
4.1.2 发展历史
4.1.3 工作原理
4.1.4 性能
4.1.5 主要厂商
4.2 等离子体蚀刻在标准浮栅闪存中的应用
4.2.1 标准浮栅闪存的浅槽隔离蚀刻工艺
4.2.2 标准浮栅闪存的浅槽隔离氧化层回刻工艺
4.2.3 标准浮栅闪存的浮栅蚀刻工艺
4.2.4 标准浮栅闪存的控制栅极蚀刻工艺
4.2.5 标准浮栅闪存的侧墙蚀刻工艺
4.2.6 标准浮栅闪存的接触孔蚀刻工艺
4.2.7 特殊结构闪存的蚀刻工艺
4.2.8 标准浮栅闪存的SADP蚀刻工艺
4.3 3D NAND关键工艺介绍
4.3.1 为何开发3D NAND闪存
4.3.2 3D NAND的成本优势
4.3.3 3D NAND中的蚀刻工艺
4.4 新型存储器与系统集成芯片
4.4.1 SoC芯片市场主要厂商
4.4.2 SoC芯片中嵌入式存储器的要求与器件种类
4.5 新型相变存储器的介绍及等离子体蚀刻的应用
4.5.1 相变存储器的下电极接触孔蚀刻工艺
4.5.2 相变存储器的GST蚀刻工艺
4.6 新型磁性存储器的介绍及等离子体蚀刻的应用
4.7 新型阻变存储器的介绍及等离子体蚀刻的应用
4.8 新型存储器存储单元为何多嵌入在后段互连结构中
4.8.1 新型存储器存储单元在后段互连结构中的嵌入形式
4.8.2 存储单元连接工艺与标准逻辑工艺的异同及影响
参考文献
第5章 等离子体蚀刻工艺中的经典缺陷介绍
5.1 缺陷的基本介绍
5.2 等离子体蚀刻工艺相关的经典缺陷及解决方法
5.2.1 蚀刻机台引起的缺陷
5.2.2 工艺间的互相影响
5.2.3 蚀刻工艺不完善所导致的缺陷
参考文献
第6章 特殊气体及低温工艺在等离子体蚀刻中的应用
6.1 特殊气体在等离子体蚀刻中的应用
6.1.1 气体材料在半导体工业中的应用及分类
6.1.2 气体材料在等离子体蚀刻中的应用及解离原理
6.1.3 特殊气体等离子体蚀刻及其应用
6.2 超低温工艺在等离子体蚀刻中的应用
6.2.1 超低温等离子体蚀刻技术简介
6.2.2 超低温等离子体蚀刻技术原理分析
6.2.3 超低温等离子体蚀刻技术应用
参考文献
第7章 等离子体蚀刻对逻辑集成电路良率及可靠性的影响
7.1 等离子体蚀刻对逻辑集成电路良率的影响
7.1.1 逻辑集成电路良率简介
7.1.2 逻辑前段蚀刻工艺对逻辑集成电路良率的影响
7.1.3 逻辑后段蚀刻工艺对逻辑集成电路良率的影响
7.2 等离子体蚀刻对逻辑集成电路可靠性的影响
7.2.1 半导体集成电路可靠性简介
7.2.2 等离子体蚀刻对HCI的影响
7.2.3 等离子体蚀刻对GOI/TDDB的影响
7.2.4 等离子体蚀刻对NBTI的影响
7.2.5 等离子体蚀刻对PID的影响
7.2.6 等离子体蚀刻对EM的影响
7.2.7 等离子体蚀刻对SM的影响
7.2.8 等离子体蚀刻对低kTDDB的影响
参考文献
第8章 等离子体蚀刻在新材料蚀刻中的展望
8.1 硅作为半导体材料在集成电路应用中面临的挑战
8.2 三五族半导体材料在集成电路中的潜在应用及其蚀刻方法
8.2.1 磷化铟的蚀刻
8.2.2 铟镓砷的蚀刻
8.2.3 镓砷的蚀刻
8.3 锗在集成电路中的潜在应用及其蚀刻方法
8.4 石墨烯在集成电路中的潜在应用及其蚀刻方法
8.5 其他二维材料在集成电路中的潜在应用及其蚀刻方法
8.6 定向自组装材料蚀刻
参考文献
第9章 先进蚀刻过程控制及其在集成电路制造中的应用
9.1 自动控制技术
9.2 传统工业先进过程控制技术
9.3 先进过程控制技术在集成电路制造中的应用
9.4 先进过程控制技术在等离子体蚀刻工艺中的应用
9.4.1 等离子体蚀刻建模
9.4.2 等离子体蚀刻过程识别
9.4.3 等离子体蚀刻过程量测
9.4.4 等离子体蚀刻先进控制实例
参考文献
第10章 虚拟制造在集成电路发展中的应用
10.1 未来集成电路技术的发展趋势
10.1.1 鳍式晶体管后时代逻辑电路技术的发展趋势:三维逻辑器件
10.1.2 集成电路研发和制造遇到的挑战
10.2 关键工艺流程模拟和虚拟制造技术
10.2.1 蚀刻模块的计算机辅助模拟
10.2.2 光刻、CMP等模块的计算机辅助模拟
10.2.3 虚拟制造中的器件模拟
10.3 设计和工艺协同关系的演化
10.3.1 可制造性设计
10.3.2 设计工艺协同优化
10.3.3 系统工艺协同优化
10.4 虚拟制造技术的展望
参考文献
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